接触孔蚀刻是先进半导体芯片制造中实现多层金属互连的核心工艺环节,其目标是在介电层中刻蚀出高深宽比(通常大于10:1)的微小通孔,实现器件有源区与上层金属布线层的电气连接。该工艺对蚀刻的各向异性、选择性、刻蚀速率及表面损伤控制提出了极高要求,而六氟化硫(SF6)作为一种性能优异的等离子体蚀刻气体,在特定接触孔蚀刻场景中发挥着关键作用。
SF6在射频等离子体环境中会发生分解,产生大量氟(F)自由基、SFx+离子及中性粒子。其中,F自由基具有极强的化学活性,能与硅(Si)、钨(W)、氮化钛(TiN)等材料发生快速化学反应,生成易挥发的氟化物(如WF6、TiF4),从而实现高效蚀刻。与传统含碳氟气体(如CF4、CHF3)相比,SF6的F自由基浓度更高,对金属及硅基材料的蚀刻速率可提升30%-50%,这一特性使其在接触孔蚀刻的金属层及阻挡层加工中具备显著优势。
接触孔蚀刻通常包含介电层蚀刻、阻挡层蚀刻及金属插塞蚀刻三个核心步骤,SF6主要应用于后两个环节:
1. **金属插塞蚀刻**:在先进逻辑芯片及存储芯片制造中,钨(W)是接触孔金属插塞的主流材料。SF6与氧气(O2)的混合气体体系可实现对钨的高效、选择性蚀刻。O2的加入不仅能通过氧化反应消耗等离子体中的碳杂质,还能在蚀刻侧壁形成薄氧化层,抑制横向蚀刻,提升各向异性。根据SEMATECH发布的《先进互连工艺蚀刻技术指南》,采用SF6/O2混合气体(体积比3:1)、1000W射频功率、5mTorr腔室压力的工艺参数,钨的蚀刻速率可达800?/min,对上层介电层(SiO2)的选择性大于20:1,完全满足7nm及以下制程接触孔的精度要求。
2. **阻挡层蚀刻**:为防止金属原子扩散至介电层,接触孔与金属布线层之间通常会沉积TiN阻挡层。SF6对TiN的蚀刻速率可达500?/min,且对下层钨插塞的选择性大于15:1,能有效实现阻挡层的精准去除,同时避免对金属插塞的过度蚀刻。台积电在其2024年技术论坛上披露,其3nm FinFET工艺中采用SF6与C4F8的混合气体体系,通过调整气体流量比及偏压功率,实现了TiN阻挡层的无损伤蚀刻,接触孔的侧壁粗糙度控制在0.5nm以内。
3. **复合蚀刻工艺**:在一些复杂的3D堆叠芯片制造中,接触孔需要贯穿多层不同材料,SF6可与CF4、CHF3等气体组合使用,实现介电层-阻挡层-金属层的连续蚀刻。例如,先采用CHF3蚀刻SiO2介电层,再切换至SF6/O2混合气体蚀刻TiN阻挡层及W金属层,整个过程无需打开腔室,有效提高了工艺效率及良率。
尽管SF6具备优异的蚀刻性能,但要满足接触孔蚀刻的高要求,需对工艺参数进行精准优化:
1. **气体配比调整**:通过调整SF6与O2、C4F8等气体的比例,平衡蚀刻速率与各向异性。例如,增加C4F8的比例可在侧壁形成更多聚合物,增强侧壁保护,但会降低蚀刻速率;提高O2比例则可提升蚀刻速率,但可能增加介电层损伤。
2. **等离子体参数控制**:射频功率、腔室压力及偏压功率是影响蚀刻效果的关键参数。较高的射频功率可提高F自由基浓度,加快蚀刻速率,但也会增加离子轰击能量,导致表面损伤;适当降低腔室压力可减少粒子碰撞,提高蚀刻的方向性。根据IEEE Transactions on Electron Devices 2023年发表的论文,采用1200W射频功率、3mTorr压力、200W偏压功率的参数组合,SF6对TiN的蚀刻选择性可提升至25:1,接触孔的深宽比可达20:1。
3. **温度控制**:腔室温度对SF6的分解及蚀刻产物的挥发有显著影响。将腔室温度控制在-10℃至20℃之间,可促进蚀刻产物的快速挥发,避免在接触孔底部沉积,从而提高蚀刻的均匀性。
需要注意的是,SF6是一种强温室气体,其全球变暖潜能值(GWP)是CO2的23500倍,且在大气中的寿命长达3200年。为应对环保压力,半导体行业正积极推动SF6的减排与替代。目前,部分厂商已开始采用NF3作为SF6的替代气体,NF3的GWP仅为SF6的1/17,且对金属的蚀刻性能接近SF6。但NF3的蚀刻速率略低,需要调整工艺参数以满足产能要求。此外,干法蚀刻技术的创新,如原子层蚀刻(ALE),也为接触孔蚀刻提供了新的解决方案,ALE可实现原子级精度的蚀刻,减少对蚀刻气体的依赖。
尽管面临环保挑战,SF6凭借其优异的蚀刻性能,在当前及未来一段时间内仍将是接触孔蚀刻的关键气体之一。半导体厂商通过优化回收系统,可将SF6的回收率提升至95%以上,有效降低其环境影响。例如,三星电子在其平泽工厂建立了SF6闭环回收系统,每年减少约1000吨CO2当量的温室气体排放。
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