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SF6在半导体芯片制造中,能否用于芯片的栅极蚀刻?

2026-04-17 752

SF6(六氟化硫)在半导体芯片制造中可用于特定场景下的栅极蚀刻,但并非栅极制程的主流蚀刻气体,其应用需结合制程节点、栅极材料及蚀刻精度要求综合评估。

从蚀刻机理来看,SF6在等离子体环境下会分解产生高活性的F自由基,能与硅(Si)、钨(W)等材料发生反应,生成挥发性的SiF4、WF6等产物,实现材料的去除。这种强蚀刻能力使其在早期半导体制程中曾用于多晶硅栅极的粗蚀刻阶段,但随着制程节点推进至14nm及以下,栅极特征尺寸缩小至数十纳米级别,对蚀刻的各向异性、选择性及损伤控制提出了极高要求,SF6的应用逐渐受到限制。

栅极蚀刻的核心要求包括:一是高各向异性,确保垂直方向的蚀刻速率远高于横向,避免栅极侧壁出现钻蚀;二是严格的材料选择性,例如蚀刻多晶硅栅极时,需对下方的SiO2栅介质层实现100:1以上的选择比,防止介质层损伤导致器件阈值电压偏移;三是低等离子体损伤,避免栅极材料或介质层因离子轰击产生缺陷,影响器件可靠性。

SF6的局限性主要体现在三个方面:其一,F自由基的蚀刻选择性较差,对SiO2、HfO2等常用栅介质材料的蚀刻速率较高,难以满足先进制程中对介质层的保护需求;其二,SF6等离子体的离子轰击能量较高,易导致栅极侧壁的非晶化或缺陷引入,增加器件漏电风险;其三,SF6的温室效应潜能(GWP)高达23500,远高于其他蚀刻气体,不符合当前半导体行业的低碳减排趋势,多数晶圆厂已逐步减少其在前端制程中的使用。

在特定场景下,SF6可与其他气体混合使用以优化蚀刻效果。例如,在130nm及以上制程的多晶硅栅极蚀刻中,SF6与Cl2的混合气体可平衡蚀刻速率与选择性,通过调整气体比例实现对蚀刻剖面的控制;部分特殊制程中,SF6也用于金属栅极(如钨栅极)的移除或修正蚀刻,但需搭配精确的等离子体参数调控。

根据SEMATECH(国际半导体技术路线图组织)2024年发布的《先进蚀刻制程技术报告》,当前7nm及以下制程的栅极蚀刻主流方案为HBr/O2混合气体等离子体蚀刻,或采用Cl2/Ar组合实现对高k金属栅极的精细蚀刻,SF6仅在部分成熟制程的非关键步骤中作为辅助气体使用。此外,应用材料(Applied Materials)、泛林半导体(Lam Research)等设备厂商的最新蚀刻系统也已针对低GWP气体进行优化,进一步压缩了SF6的应用空间。

SF6在半导体栅极蚀刻中具有一定技术可行性,但受限于选择性、损伤控制及环保要求,应用范围已大幅缩小,仅适用于特定成熟制程或非关键蚀刻步骤。先进制程的栅极蚀刻需采用更精细化的气体组合与制程控制技术,以满足纳米级器件的制造需求。

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